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9us at 85°c • asynchronous reset • pcb: height mm) or mm)8us at lower than tcase 85°c, 35v (v ~v) power supply • vddq = 15v (v ~ v) • 667mhz fck for mb/sec/pin • 8 independent internal bank • programmable cas latency: • programmable additive latency: 0, cl - 2, or cl - 1 clock • programmable cas write latency(cwl) = 7 (ddr-bit pre-fetch • burst length: 8 (interleave without any limit, sequential with starting address “000” only), 4 with tccd = 4 which does not allow seamless read or write [either on the fly using a12 or mrs] • bi-directional differential data strobe • internal(self) calibration: internal self calibration through zq pin (rzq: 240 ohm ± 1%) • on die termination using odt pin • average refresh period 7kvr13n9s8/4 4gb 1rxm x 64-bit pc cl-pin dim features • jedec standard 1
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